JTAG Technologies, führender Anbieter von Boundary-Scan-Lösungen lädt Sie ein uns auf der embedded world 2016 in Nürnberg zu besuchen und zwei heiße Themen aus dem Bereich des Baugruppentests zu diskutieren:
Design for Testability (DfT)
Die Herausforderungen testgerechten Designs ähneln einem ‚Aschenputtel-Job’ innerhalb des gesamten Designprozesses. Dessen Herausforderungen zu bewältigen ist nicht so spannend, wie das Entwickeln neuer Produkte und Lösungen. Trotzdem dürfen die Aspekte testgerechten Designs (DfT) nicht ignoriert werden. Ein Design, das die Testbarkeits-Thematik so umsetzt, dass keine Ergänzungen erforderlich werden, die die ursprüngliche Schaltung beeinträchtigen, ist so wahrscheinlich wie ein Prototyp, der unverändert in Stückzahlen ‚vom Band rollt’.
Design for Testability (DfT)
Die Herausforderungen testgerechten Designs ähneln einem ‚Aschenputtel-Job’ innerhalb des gesamten Designprozesses. Dessen Herausforderungen zu bewältigen ist nicht so spannend, wie das Entwickeln neuer Produkte und Lösungen. Trotzdem dürfen die Aspekte testgerechten Designs (DfT) nicht ignoriert werden. Ein Design, das die Testbarkeits-Thematik so umsetzt, dass keine Ergänzungen erforderlich werden, die die ursprüngliche Schaltung beeinträchtigen, ist so wahrscheinlich wie ein Prototyp, der unverändert in Stückzahlen ‚vom Band rollt’.
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