Als Reaktion auf den zunehmenden Trend in der Elektronikindustrie zur Nutzung eingebetteter Instrumentation richtet ASSET® InterTech, Inc. (www.asset-intertech.com) das Unternehmen, die Produkte und Technologien auf die Bereitstellung offener Tools für die eingebettete Instrumentation in Design-Validierungs-, Test- und Debugging-Anwendungen aus.
Für schnelle Chips, I/O-Busse und Systeme sind viele der gängigen Validierungs- und Testtechnologien unzureichend oder ineffektiv. Neue Chip-Geometrien mit 45 Nanometer (nm) und weniger sowie Chip-Level-Packaging-Technologien wie SiP (System-in-a-Package) machen darüber hinaus Validierung, Test und Debugging mit herkömmlichen Technologien sehr schwierig, teilweise sogar unmöglich. Auf Grundlage der langjährigen Führungsposition im Bereich berührungsloser Boundary-Scan-Strukturtests auf Basis des IEEE 1149.1 JTAG Standards hat
Für schnelle Chips, I/O-Busse und Systeme sind viele der gängigen Validierungs- und Testtechnologien unzureichend oder ineffektiv. Neue Chip-Geometrien mit 45 Nanometer (nm) und weniger sowie Chip-Level-Packaging-Technologien wie SiP (System-in-a-Package) machen darüber hinaus Validierung, Test und Debugging mit herkömmlichen Technologien sehr schwierig, teilweise sogar unmöglich. Auf Grundlage der langjährigen Führungsposition im Bereich berührungsloser Boundary-Scan-Strukturtests auf Basis des IEEE 1149.1 JTAG Standards hat
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