Cadence Design Systems, Inc. (NYSE: CDN) und Virage Logic Corporation (Nasdaq: VIRL) geben bekannt, dass die führende
digitale IC-Designplattform Cadence Encounter nun auch die Area, Speed and Power (ASAP) Logic Structured-ASIC Metal Programmable und Standard Cell Libraries unterstützt. Damit können die in der Produktion bewährten Möglichkeiten der IC-Implementierung von SoC Encounter nun auch im Bereich der strukturierten Arrays und der Standardzellen genutzt werden. Darüber hinaus ermöglicht dies den Kunden entsprechend den jeweiligen Anforderungen auch Kompromisse hinsichtlich der Dichte, Kosten und Leistung. Diese Möglichkeit ist ab SoC Encounter 3.3 einsetzbar, das sich gegenwärtig in der Produktion befindet.
Über die ASAP
digitale IC-Designplattform Cadence Encounter nun auch die Area, Speed and Power (ASAP) Logic Structured-ASIC Metal Programmable und Standard Cell Libraries unterstützt. Damit können die in der Produktion bewährten Möglichkeiten der IC-Implementierung von SoC Encounter nun auch im Bereich der strukturierten Arrays und der Standardzellen genutzt werden. Darüber hinaus ermöglicht dies den Kunden entsprechend den jeweiligen Anforderungen auch Kompromisse hinsichtlich der Dichte, Kosten und Leistung. Diese Möglichkeit ist ab SoC Encounter 3.3 einsetzbar, das sich gegenwärtig in der Produktion befindet.
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